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VHDL CPU部件
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- 采用Quatus II编译环境，使用Verilog HDL语言编写实现了五段流水线CPU。 能够完成以下二十二条指令（均不考虑虚拟地址和Cache，并且默认为小端方式）： add rd,rs,rt addu rd,rs,rt addi rt,rs,imm addiu rt,rs,imm sub rd,rs,rt subu rd,rs,rt nor rd,rs,rt xori rt,rs,imm clo rd,rs clz rd,rs slt rd,rs,rt sltu rd,
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- 智能电子钱包终端设计（一） ——CPU卡与COS文件结构-E-purse smart terminal design (a)- CPU card file structure and COS
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- CPU曲线跳舞的小程序设计 可以将CPU曲线变为三角形 正弦-CPU curve small dance program design can be CPU sine curve into triangles
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